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Impulse Accelerated Technologies公司最近推出2.0版的CoDeveloper C-to-FPGA設(shè)計工具。新版本包括一個新的編譯器,速度提高達兩倍,并提高了設(shè)計質(zhì)量,使其可與手工優(yōu)化的設(shè)計相比。

2.0版增加了對模塊生成的支持,允許從C語言生成硬件IP模塊,并使用指定端口將這些模塊與整體設(shè)計集成在一起。在改進對VHDL的支持的同時,新版本增加了Verilog編譯器輸出。

Impulse公司透露,新版本包含擴展指令調(diào)度和循環(huán)管線操作,大大地改善了設(shè)計結(jié)果的質(zhì)量,改進的地方包括:支持定寬(fixed-width integer)整數(shù)、定點數(shù)學(xué)操作、優(yōu)化器報告(包括管線有效率估計)、通過應(yīng)用管理器和應(yīng)用監(jiān)控器接口進行的桌面模擬。

新版本改進了對嵌入式處理器的支持,包括支持最新的Altera和Xilinx處理器和相關(guān)軟件設(shè)計環(huán)境。CoDeveloper的設(shè)計初衷是促使FPGA算法可與現(xiàn)有的C/C++工具協(xié)同開發(fā)和調(diào)試。這種軟件到硬件編譯器將C語言處理翻譯成低級FPGA硬件語言,并優(yōu)化生成的邏輯。

CoDeveloper 2.0每年度許可費為2,695美元,永久許可費為4,995美元,符合資格的工程師可免費獲得30天試用版。