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隨著半導(dǎo)體的幾何尺寸在不斷減小,必須面對(duì)這個(gè)趨勢(shì)的人們面臨著交織在一起的各種挑戰(zhàn),包括可制造性,復(fù)雜性和規(guī)模。對(duì)于Cadence Design Systems這個(gè)主要的EDA公司和該公司的總裁兼CEOJ. Fister來(lái)說(shuō),意味著必須從不同的角度來(lái)看待這個(gè)設(shè)計(jì)過(guò)程。

在Cadence公司每年一度的CDNLive用戶會(huì)議中,Fister 2007年在印度的會(huì)議上表示除了片上系統(tǒng)的所面臨的不同的困難所帶來(lái)的復(fù)雜性,還有保持對(duì)90納米及其以下尺寸的高級(jí)過(guò)程結(jié)點(diǎn)可制造性,包括化學(xué)機(jī)械??光,CMP和光刻。事實(shí)上,他指出,所有的過(guò)程都很復(fù)雜,做多一點(diǎn)才可以在全球IC市場(chǎng)上獲得更多的份額。

可制造性的問(wèn)題也許可以解決,他說(shuō),通過(guò)采用一種具有電子意識(shí)的可制造性設(shè)計(jì)的觀念,結(jié)合預(yù)防、分析和優(yōu)化的一種思維過(guò)程,還有基于模型的驗(yàn)證。“設(shè)備的可制造性需要提前把制造元素融入設(shè)計(jì)的理念在增強(qiáng),這是過(guò)去15年的引人注目的變化。完全有必要繼續(xù)從摩爾定律中遷移過(guò)來(lái),自動(dòng)化的核心是測(cè)試所有的情況”,Fister指出。他還表示在復(fù)雜性和規(guī)模設(shè)計(jì)上的挑戰(zhàn)包括設(shè)計(jì)的尺寸以及要包含多種協(xié)議的必要性。這是一個(gè)全盤(pán)的設(shè)計(jì),涉及端到端的能耗管理,統(tǒng)一的時(shí)序引擎和高級(jí)功能驗(yàn)證。

Cadence采用了全盤(pán)的方式,利用它的工具考慮到了優(yōu)化而不是僅僅整合各種設(shè)計(jì)元素。Fister認(rèn)為,“這種工具的方式是一個(gè)絕妙的想法,是長(zhǎng)期以來(lái)其他行業(yè)只采用的一種平行的解決方式。這個(gè)想法是高級(jí)的而不是重新發(fā)明輪子,特別是小型公司可以發(fā)現(xiàn)這種工具是有用的”,他還補(bǔ)充說(shuō)推動(dòng)Cadence的前進(jìn)動(dòng)力是把更多的半導(dǎo)體行業(yè)的經(jīng)驗(yàn)融合進(jìn)企業(yè)。